| 課程級(jí)別 | 入門(mén)級(jí) |
| 培訓(xùn)周期 | 1-2個(gè)月 |
| 上課時(shí)間 | 全日制 |
| 上課地址 | 深圳南山區(qū)南新路蘇豪大廈705室 |
☆★學(xué)校簡(jiǎn)介
深圳信盈達(dá)電子有限公司是1家專(zhuān)注于單片機(jī)、ARM、嵌入式產(chǎn)品開(kāi)發(fā)和技術(shù)培訓(xùn)的高新技術(shù)服務(wù)企業(yè)，公司下設(shè)開(kāi)發(fā)部和技術(shù)培訓(xùn)部。公司開(kāi)發(fā)部為國(guó)內(nèi)外眾多客戶(hù)開(kāi)發(fā)多款基于嵌入式單片機(jī)、ARM等技術(shù)的整套方案和高性能產(chǎn)品，技術(shù)培訓(xùn)部提供的單片機(jī)、ARM、嵌入式產(chǎn)品開(kāi)發(fā)工程師培訓(xùn)。同時(shí)為眾多工程師，各大師專(zhuān)院校提供高質(zhì)量的實(shí)驗(yàn)器材及技術(shù)培訓(xùn)課程！
伴隨著社會(huì)經(jīng)濟(jì)發(fā)展，產(chǎn)業(yè)轉(zhuǎn)型，中國(guó)已經(jīng)從“中國(guó)制造”轉(zhuǎn)向“中國(guó)創(chuàng)造”，科技技術(shù)是此次產(chǎn)業(yè)升級(jí)的大動(dòng)力。觀(guān)察下就可以發(fā)現(xiàn)目前單片機(jī)、ARM為代表的嵌入式芯片已滲透到我們生活各個(gè)領(lǐng)域中，并改變著我們的生活，用單片機(jī)控制實(shí)現(xiàn)的產(chǎn)品隨處可見(jiàn)，如數(shù)碼產(chǎn)品、 安防監(jiān)控、儀器 、儀表、家電、機(jī)電1體化、汽車(chē)單元控制、及工業(yè)控制等很多方面。因此專(zhuān)業(yè)單片機(jī)開(kāi)發(fā)人才才出現(xiàn)大規(guī)模的缺口，據(jù)調(diào)查目前我國(guó)單片機(jī)從業(yè)人員只有150萬(wàn)人，人員緊缺；隨著社會(huì)的發(fā)展，單片機(jī)從業(yè)人員更為搶·手，據(jù)不完全統(tǒng)計(jì)，到2012年，我國(guó)單片機(jī)行業(yè)人員需求將達(dá)到300萬(wàn)人。而學(xué)習(xí)掌握好單片機(jī)知識(shí)也是今后掌握更的嵌入式CPU的必經(jīng)之路，所以許多人迫切希望進(jìn)修單片機(jī)的知識(shí)，渴求在短的時(shí)間內(nèi)盡快掌握單片機(jī)產(chǎn)品開(kāi)發(fā)的基本技能。
☆★ 課程簡(jiǎn)介
課程內(nèi)容 | 課程目標(biāo) | |
全程共XX課時(shí)；周末班XX天，班XX天；實(shí)踐考核X次，筆試考核X次。 | ||
第一階段 | 主要幫助學(xué)員了解FPGA系統(tǒng)設(shè)計(jì)的基礎(chǔ)知識(shí)，掌握FPGA小系統(tǒng)硬件電路設(shè)計(jì)方法，學(xué)會(huì)操作QuartusII軟件來(lái)完成FPGA的設(shè)計(jì)和開(kāi)發(fā)。 | |
1 可編程邏輯器件簡(jiǎn)介 | ||
2 可編程邏輯器件的發(fā)展歷史 | ||
3 FPGA/CPLD的基本結(jié)構(gòu)：FPGA的基本結(jié)構(gòu)；CPLD的基本結(jié)構(gòu)；FPGA和CPLD的比較；FPGA/CPLD的設(shè)計(jì)流程。 | ||
4 PLD/FPGA的分類(lèi)和使用 | ||
5 FPGA關(guān)鍵電路的設(shè)計(jì)（小電路設(shè)計(jì)）：FPGA管腳設(shè)計(jì)；下載配置與調(diào)試接口電路設(shè)計(jì)；高速SDRAM存儲(chǔ)器接口電路設(shè)計(jì)；異步SRAM（ASRAM）存儲(chǔ)器接口電路設(shè)計(jì)；FLASH存儲(chǔ)器接口電路設(shè)計(jì)；開(kāi)關(guān)、按鍵與發(fā)光LED電路設(shè)計(jì)；VGA接口電路設(shè)計(jì)；PS/2鼠標(biāo)及鍵盤(pán)接口電路設(shè)計(jì)；RS-232串口；字符型液晶顯示器接口電路設(shè)計(jì)；USB2.0接口芯片CY7C68013電路設(shè)計(jì)；電源電路設(shè)計(jì)；復(fù)位電路設(shè)計(jì)；撥碼開(kāi)關(guān)電路設(shè)計(jì)；IC總線(xiàn)電路設(shè)計(jì)；時(shí)鐘電路設(shè)計(jì)；圖形液晶電路設(shè)計(jì)。 | ||
第二階段 | 了解目前流行的Verilog HDL語(yǔ)言的基本語(yǔ)法；掌握Verilog HDL語(yǔ)言中常用的基本語(yǔ)法；設(shè)計(jì)一些簡(jiǎn)單的FPGA程序；掌握組合邏輯和時(shí)序邏輯電路的設(shè)計(jì)方法；對(duì)Verilog HDL語(yǔ)言有更深入的理解和認(rèn)識(shí)。 | |
1 硬件描述語(yǔ)言簡(jiǎn)介 ：Verilog HDL的特點(diǎn)；Verilog HDL的設(shè)計(jì)流程簡(jiǎn)介。 | ||
2 Verilog模塊的基本概念和結(jié)構(gòu) ：Verilog模塊的基本概念；Verilog HDL模塊的基本結(jié)構(gòu)。 | ||
3 數(shù)據(jù)類(lèi)型及其常量及變量 | ||
4 運(yùn)算符及表達(dá)式 ：算術(shù)運(yùn)算符；關(guān)系運(yùn)算符；邏輯運(yùn)算符；按位邏輯運(yùn)算符；條件運(yùn)算符；移位運(yùn)算符；拼接運(yùn)算符；縮減運(yùn)算符。 | ||
5 條件語(yǔ)句和循環(huán)語(yǔ)句 ：條件語(yǔ)句；case 語(yǔ)句；while語(yǔ)句；for語(yǔ)句。 | ||
6 結(jié)構(gòu)說(shuō)明語(yǔ)句 ：initial語(yǔ)句；always語(yǔ)句；task和function語(yǔ)句。 | ||
7 系統(tǒng)函數(shù)和任務(wù) ：標(biāo)準(zhǔn)輸出任務(wù)；控制任務(wù)；時(shí)間度量系統(tǒng)函數(shù)；文件管理任務(wù)。 | ||
8 小結(jié) | ||
第三階段：Altera FPGA設(shè)計(jì) | ||
1 Altera高密度FPGA：主流高端FPGA——Stratix系列；內(nèi)嵌高速串行收發(fā)器的FPGA Stratix GX系列。 | ||
2 Altera的Cyclone系列低成本FPGA ：新型可編程架構(gòu)；嵌入式存儲(chǔ)資源；專(zhuān)用外部存儲(chǔ)接口電路；支持的接口和協(xié)議；鎖相環(huán)的實(shí)現(xiàn)；I/0特性；Nios II嵌入式處理器；配置方案。 | ||
3 Altera的MAX II系列CPLD器件 | ||
4 Quartus II軟件綜述 ：Quartus II軟件的特點(diǎn)及支持的器件；Quartus II軟件的工具及功能簡(jiǎn)介；Quartus II軟件的用戶(hù)界面。 | ||
5 設(shè)計(jì)輸入 ：建立工程；建立設(shè)計(jì)。 | ||
6 綜合 | ||
7 布局布線(xiàn) | ||
8 | ||
9 編程與配置 | ||
10 小結(jié) | ||
第四階段：學(xué)習(xí)FPGA產(chǎn)品設(shè)計(jì)核心技術(shù)。 | ||
1 FPGA的硬件設(shè)計(jì)技術(shù) | ||
2 基于Nios II的S0PC系統(tǒng)設(shè)計(jì) | ||
3 Nios II的S0PC系統(tǒng)的設(shè)計(jì)實(shí)例 | ||
4 系統(tǒng)時(shí)序邏輯設(shè)計(jì)技術(shù) | ||
5 基于FPGA的IP核設(shè)計(jì)技術(shù) | ||
6 FPGA的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì) | ||
7 基于FPGA的硬件回路器設(shè)計(jì) | ||
第五階段：Alter的IP工具 | ||
1 IP的概念 | ||
2 Alter可提供的IP | ||
3 Alter IP在設(shè)計(jì)中的作用 | ||
4 使用Alter的基本宏功能 | ||
5 使用Alter的IP核 | ||
第六階段：總結(jié)答疑，項(xiàng)目實(shí)戰(zhàn)。 | 由工程師安排項(xiàng)目制作，學(xué)員一起討論選項(xiàng)目；也可學(xué)員自帶項(xiàng)目，經(jīng)公司評(píng)估后可指派專(zhuān)人進(jìn)行指導(dǎo)完成。 | |
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